Autor propõe desafio para projetar hardware capaz de executar linguagens de alto nível com desempenho próximo (≤25% de perda) de CPUs RISC, sem grandes penalidades de silício.
Autor está disposto a implementar fisicamente e fabricar o chip caso o projeto cumpra os requisitos, oferecendo reconhecimento público e envio de amostra.
Crítica a declarações vagas de Alan Kay, Jamie Zawinski e Steve Yegge sobre eficiência de linguagens de alto nível sem detalhes técnicos ou benchmarks concretos.
Argumenta que instruções de alto nível em hardware trazem pouco ganho, aumentam a complexidade e não são facilmente aproveitadas por compiladores.
Discute custos de tipagem dinâmica, coleta de lixo e overhead de memória, questionando suposições intuitivas sobre segurança e performance.
Aponta que arquiteturas não von Neumann exigem novos modelos de programação e solicita propostas detalhadas para aplicações como processamento de imagens.
Desafia autores a apresentarem arquitetura e modelo de programação completos, caso contrário devem cessar críticas vazias ao hardware tradicional.
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